284 lines
7.4 KiB
C
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7.4 KiB
C
/*
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* Coldfire generic GPIO support
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* (C) Copyright 2009, Steven King <sfking@fdwdc.com>
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* This program is free software; you can redistribute it and/or modify
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* it under the terms of the GNU General Public License as published by
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* the Free Software Foundation; version 2 of the License.
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*
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* This program is distributed in the hope that it will be useful,
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* but WITHOUT ANY WARRANTY; without even the implied warranty of
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* MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
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* GNU General Public License for more details.
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*/
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#include <linux/kernel.h>
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#include <linux/init.h>
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#include <asm/coldfire.h>
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#include <asm/mcfsim.h>
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|
#include <asm/mcfgpio.h>
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static struct mcf_gpio_chip mcf_gpio_chips[] = {
|
|
{
|
|
.gpio_chip = {
|
|
.label = "PIRQ",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value,
|
|
.ngpio = 8,
|
|
},
|
|
.pddr = MCFEPORT_EPDDR,
|
|
.podr = MCFEPORT_EPDR,
|
|
.ppdr = MCFEPORT_EPPDR,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "ADDR",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 13,
|
|
.ngpio = 3,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_ADDR,
|
|
.podr = MCFGPIO_PODR_ADDR,
|
|
.ppdr = MCFGPIO_PPDSDR_ADDR,
|
|
.setr = MCFGPIO_PPDSDR_ADDR,
|
|
.clrr = MCFGPIO_PCLRR_ADDR,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "DATAH",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 16,
|
|
.ngpio = 8,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_DATAH,
|
|
.podr = MCFGPIO_PODR_DATAH,
|
|
.ppdr = MCFGPIO_PPDSDR_DATAH,
|
|
.setr = MCFGPIO_PPDSDR_DATAH,
|
|
.clrr = MCFGPIO_PCLRR_DATAH,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "DATAL",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 24,
|
|
.ngpio = 8,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_DATAL,
|
|
.podr = MCFGPIO_PODR_DATAL,
|
|
.ppdr = MCFGPIO_PPDSDR_DATAL,
|
|
.setr = MCFGPIO_PPDSDR_DATAL,
|
|
.clrr = MCFGPIO_PCLRR_DATAL,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "BUSCTL",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 32,
|
|
.ngpio = 8,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_BUSCTL,
|
|
.podr = MCFGPIO_PODR_BUSCTL,
|
|
.ppdr = MCFGPIO_PPDSDR_BUSCTL,
|
|
.setr = MCFGPIO_PPDSDR_BUSCTL,
|
|
.clrr = MCFGPIO_PCLRR_BUSCTL,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "BS",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 40,
|
|
.ngpio = 4,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_BS,
|
|
.podr = MCFGPIO_PODR_BS,
|
|
.ppdr = MCFGPIO_PPDSDR_BS,
|
|
.setr = MCFGPIO_PPDSDR_BS,
|
|
.clrr = MCFGPIO_PCLRR_BS,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "CS",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 49,
|
|
.ngpio = 7,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_CS,
|
|
.podr = MCFGPIO_PODR_CS,
|
|
.ppdr = MCFGPIO_PPDSDR_CS,
|
|
.setr = MCFGPIO_PPDSDR_CS,
|
|
.clrr = MCFGPIO_PCLRR_CS,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "SDRAM",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 56,
|
|
.ngpio = 6,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_SDRAM,
|
|
.podr = MCFGPIO_PODR_SDRAM,
|
|
.ppdr = MCFGPIO_PPDSDR_SDRAM,
|
|
.setr = MCFGPIO_PPDSDR_SDRAM,
|
|
.clrr = MCFGPIO_PCLRR_SDRAM,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "FECI2C",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 64,
|
|
.ngpio = 4,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_FECI2C,
|
|
.podr = MCFGPIO_PODR_FECI2C,
|
|
.ppdr = MCFGPIO_PPDSDR_FECI2C,
|
|
.setr = MCFGPIO_PPDSDR_FECI2C,
|
|
.clrr = MCFGPIO_PCLRR_FECI2C,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "UARTH",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 72,
|
|
.ngpio = 2,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_UARTH,
|
|
.podr = MCFGPIO_PODR_UARTH,
|
|
.ppdr = MCFGPIO_PPDSDR_UARTH,
|
|
.setr = MCFGPIO_PPDSDR_UARTH,
|
|
.clrr = MCFGPIO_PCLRR_UARTH,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "UARTL",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 80,
|
|
.ngpio = 8,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_UARTL,
|
|
.podr = MCFGPIO_PODR_UARTL,
|
|
.ppdr = MCFGPIO_PPDSDR_UARTL,
|
|
.setr = MCFGPIO_PPDSDR_UARTL,
|
|
.clrr = MCFGPIO_PCLRR_UARTL,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "QSPI",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 88,
|
|
.ngpio = 5,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_QSPI,
|
|
.podr = MCFGPIO_PODR_QSPI,
|
|
.ppdr = MCFGPIO_PPDSDR_QSPI,
|
|
.setr = MCFGPIO_PPDSDR_QSPI,
|
|
.clrr = MCFGPIO_PCLRR_QSPI,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "TIMER",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 96,
|
|
.ngpio = 4,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_TIMER,
|
|
.podr = MCFGPIO_PODR_TIMER,
|
|
.ppdr = MCFGPIO_PPDSDR_TIMER,
|
|
.setr = MCFGPIO_PPDSDR_TIMER,
|
|
.clrr = MCFGPIO_PCLRR_TIMER,
|
|
},
|
|
{
|
|
.gpio_chip = {
|
|
.label = "ETPU",
|
|
.request = mcf_gpio_request,
|
|
.free = mcf_gpio_free,
|
|
.direction_input = mcf_gpio_direction_input,
|
|
.direction_output = mcf_gpio_direction_output,
|
|
.get = mcf_gpio_get_value,
|
|
.set = mcf_gpio_set_value_fast,
|
|
.base = 104,
|
|
.ngpio = 3,
|
|
},
|
|
.pddr = MCFGPIO_PDDR_ETPU,
|
|
.podr = MCFGPIO_PODR_ETPU,
|
|
.ppdr = MCFGPIO_PPDSDR_ETPU,
|
|
.setr = MCFGPIO_PPDSDR_ETPU,
|
|
.clrr = MCFGPIO_PCLRR_ETPU,
|
|
},
|
|
};
|
|
|
|
static int __init mcf_gpio_init(void)
|
|
{
|
|
unsigned i = 0;
|
|
while (i < ARRAY_SIZE(mcf_gpio_chips))
|
|
(void)gpiochip_add((struct gpio_chip *)&mcf_gpio_chips[i++]);
|
|
return 0;
|
|
}
|
|
|
|
core_initcall(mcf_gpio_init);
|